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Filtro digital IIR implementado en FPGA DEO - Nano para eliminación del ruido Gaussiano presente en señal determinística de la densidad poblacional de neutrones / Alejandro Ule Duque; Director Vladimir Mosquera Cerquera, Daniel Suescún Díaz: Asesor de Tesis Johan Julián Molina Mosquera, Julián Adolfo Ramírez Gutiérrez

By: Ule Duque, Alejandro [autor].
Contributor(s): Mosquera Cerquera, Vladimir [Director] | Suescún Díaz, Daniel [Director] | Molina Mosquera, Johan Julián [Asesor de tesis] | Ramírez Gutiérrez, Julián Adolfo [Asesor de tesis].
Neiva: Universidad Surcolombiana, 2024Description: 1 CD-ROM (53 páginas); diagramas, fotografías, tablas o cuadros; 12 cm.Content type: texto Media type: computadora Carrier type: disco de la computadoraSubject(s): Ingeniería Electrónica -- Implementación Filtro Digital | Ruido Gaussiano -- Señal DeteminísticaDDC classification: Th IE 408
Contents:
Introducción -- Objetivos -- Marco teórico -- Análisis frecuencial de señal determinística -- Diseño -- Implementación -- Resultados -- Conclusiones
Dissertation note: Tesis Ingeniero Electrónico Universidad Surcolombiana. Facultad de Ingeniería. Ingeniería Electrónica 2024 Summary: "Este trabajo desarrolla el diseño y la implementación de un filtro digital con respuesta infinita al impulso (IIR) en la FPGA DE0 – Nano de Altera. El diseño se realiza a partir de un filtro analógico Chebyshev con rizado en la banda pasante, y luego se aplica la transformación bilineal para su digitalización. Se establece la etapa de filtrado con el fin de eliminar el ruido gaussiano presente en la señal determinística de densidad poblacional de neutrones, la cual es necesaria para realizar el cálculo de reactividad nuclear. El cálculo de este parámetro se realiza a partir de la ecuación inversa de la cinética puntual, la cual resulta de resolver las ecuaciones de cinética puntual que modelan la dinámica de un reactor nuclear de potencia. La ecuación inversa de cinética puntual es una ecuación integro diferencial en donde está presente la integral correspondiente al histórico de la densidad poblacional de neutrones; esta integral se resuelve por medio del método de filtro FIR (Finite Impulse Response). También desarrolla el diseño y la implementación de un sistema basado en el procesador Nios II/f, el cual contiene diferentes núcleos como memoria RAM, núcleo de protocolo UART con el estándar RS-232, generador de señal de reloj y controlador en paralelo de entradas y salidas del chip."
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e-Tesis e-Tesis Biblioteca Central
Tesis y Trabajos de Grado Th IE 408 (Browse shelf) Ej.1 Available 900000027098
e-Tesis e-Tesis Biblioteca Central
Tesis y Trabajos de Grado Th IE 408 (Browse shelf) Ej.2 Available 900000027099
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Tesis Ingeniero Electrónico Universidad Surcolombiana. Facultad de Ingeniería. Ingeniería Electrónica 2024

Introducción -- Objetivos -- Marco teórico -- Análisis frecuencial de señal determinística -- Diseño -- Implementación -- Resultados -- Conclusiones

"Este trabajo desarrolla el diseño y la implementación de un filtro digital con respuesta infinita al impulso (IIR) en la FPGA DE0 – Nano de Altera. El diseño se realiza a partir de un filtro analógico Chebyshev con rizado en la banda pasante, y luego se aplica la transformación bilineal para su digitalización. Se establece la etapa de filtrado con el fin de eliminar el ruido gaussiano presente en la señal determinística de densidad poblacional de neutrones, la cual es necesaria para realizar el cálculo de reactividad nuclear. El cálculo de este parámetro se realiza a partir de la ecuación inversa de la cinética puntual, la cual resulta de resolver las ecuaciones de cinética puntual que modelan la dinámica de un reactor nuclear de potencia. La ecuación inversa de cinética puntual es una ecuación integro diferencial en donde está presente la integral correspondiente al histórico de la densidad poblacional de neutrones; esta integral se resuelve por medio del método de filtro FIR (Finite Impulse Response). También desarrolla el diseño y la implementación de un sistema basado en el procesador Nios II/f, el cual contiene diferentes núcleos como memoria RAM, núcleo de protocolo UART con el estándar RS-232, generador de señal de reloj y controlador en paralelo de entradas y salidas del chip."

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